【導讀】AT32的微控製器內置最多三個高級12位片上SAR模擬數字轉換器（ADC）並提供自校準功能，用於提高環境條件變化時的ADC精度。在涉及模數轉換的應用中，ADC精度會影響整體的係統質量和效率。為了提高此精度
，必須了解ADC相關的運作和影響精度的原因。

概述 

AT32的微控製器內置最多三個高級12位片上SAR模擬數字轉換器（ADC）並提供自校準功能，用於提高環境條件變化時的ADC精度。在涉及模數轉換的應用中，ADC精度會影響整體的係統質量和效率。為了提高此精度，必須了解ADC相關的運作和影響精度的原因。

SAR ADC使用一個采樣電容充電至輸入信號電壓，SAR邏輯對此電壓做數據轉換。然而
，這個ADC內的采樣電容是由外部的信號源直接充電的，也因著采樣電容值、輸入阻抗
、還有外部線路影響
，需要一段充電穩定時間來保證對輸入信號電壓量測的準確性。為達到好的ADCliangce，bixushezhizugoudecaiyangshijian。fouze，qianyicizaimouyishurutongdaozhuanhuansuocanyuzaicaiyangdianrongshangdedianhe，huiyingxiangmuqianzhengzaijinxingzhuanhuantongdaodezhunquexing。ADC精度不僅取決於ADC性能和功能，還取決於ADC周圍的整體應用設計。此應用筆記旨在幫助用戶如何設置正確軟、硬件使ADC達到準確的量測
，也提供相關應用上的注意事項。

ADC的誤差來源及其誤差最小化辦法 

本章列出了影響ADC轉換精度的主要誤差。這些類型的誤差存在於所有ADC中

，轉換質量將取決於它們的消除情況。為便於參考
，將精度誤差以LSB為單位來表達。就電壓而言，通過將LSB數乘以1 LSB對應的電壓來計算電壓誤差（1 LSB=VREF+/4096或VDDA/4096）。

ADC自身誤差

ADC自身誤差為ADC本身設計和製造時所產生本體的誤差，這類誤差通常由以下靜態參數顯示：微分線性誤差（DNL）
、積分線性誤差（INL）、偏移誤差（OE）、增益誤差（GE）、和總未調整誤差（TUE）。AT32微控製器數據手冊的ADC特性部分規定了這些誤差的定義和值。其中TUE為實際和理想傳輸曲線間的最大偏離，此參數指定可能發生的會導致理想數字輸出與實際數字輸出之間最大偏離誤差。（注意TUE不是DNL、INL
、OE、與GE之和，它可能源自同時發生的一種或多種誤差。）

AT32 ADC自校準功能可以補償偏移誤差，在ADC使用前先進行一次自校準可保證在數據手冊揭示範圍的任何環境條件之下，TUE小於4 LSB，也就是保證12位ADC靜態準確度（accuracy）可達10位以上。

至於ADC的動態參數（如：ENOB）及其代表的誤差程度，通常在語音和特定音頻應用才會考慮，在一般MCU的應用場合不會太重視，在本文中也不於討論。

ADC環境導致的誤差

參考電壓/電源噪聲

由於ADC轉換值為模擬信號電壓（VAIN）與參考電壓之比（VREF+），因此VREF+上的任何噪聲都會導致轉換後數字值的變化。在某些封裝中，VDDA模擬電源被用作參考電壓（VREF+），因此VDDA電源的質量會影響ADC誤差。VREF+幾十mV的波動就會造成十幾LSB的誤差。

就供電側噪聲而言

，開關式電源模塊通常內置快速切換功率晶體管
，這會在輸出中產生高頻噪聲

，此切換噪聲介於15 kHz至1 MHzzhijian
，yexuliuyi。xianxingwenyaqideshuchuzhilianggengjia。ruguoshiyongqiehuandianyuan
，jianyishiyongxianxingwenyaqigongyingmoniji。jianyizaidianyuanxianhedixianzhijianlianjiejuyouyoulianggaopintexingdedianrong。yingzaikaojindianyuandeweizhianzhuangyige0.1 μF和一個1至10 μF的de電dian容rong。這zhe些xie電dian容rong允yun許xu直zhi流liu信xin號hao通tong過guo它ta們men。小xiao值zhi電dian容rong過guo濾lv高gao頻pin噪zao聲sheng，高gao值zhi電dian容rong過guo濾lv低di頻pin噪zao聲sheng。要yao過guo濾lv高gao頻pin噪zao聲sheng，還hai可ke使shi用yong與yu電dian源yuan串chuan聯lian的de鐵tie氧yang體ti電dian感gan器qi（ferrite bead）。由於線的串行電阻極低，此解決方案導致的直流損失極低（可忽略不計），除非電流很大。

微控製器端VDD和VSS引腳的安裝位置很接近，因此可以在盡量靠近的位置通過極短的引線將電容連接到微控製器。VDDA和VREF+引腳必須連接到兩個外部去耦電容，100 nF陶瓷電容加上1 μF鉭電容或陶瓷電容。注意數字地與模擬地應相互隔離，避免噪聲串擾。

圖1. 具有VREF引腳封裝的電源和參考去耦

圖2. 無VREF引腳封裝的電源和參考去耦

GPIO輸入電壓電平超出常規

AT32F403係列

、AT32F413係列
、和AT32F415係列作為具有ADC輸入功能的任一GPIO引腳，輸入的電壓不能超過VDD+0.3V（VDDA與VDD須同電位），否則會由芯片內部幹擾ADC輸入信號。隻要是ADC輸入功能的GPIO，即使隻當I/O輸入用途
，如果輸入的電壓超過VDD+0.3V，也會幹擾其它ADC通道轉換結果。如果存在此種高電壓，建議使用電阻分壓或減壓到小於VDD的電壓範圍。

其它AT32型號MCU則沒有以上限製（例如：AT32F403A、AT32F407、AT32F421、AT32F435/437等係列），所有具有ADC輸入功能的GPIO引腳都是耐5V引腳。這類引腳在未使用作ADC輸入信號而作為數字輸入時，需設置為浮空輸入、輸入上拉
、或輸入下拉模式，就可以輸入高於VDD的電壓而不幹擾ADC的操作。但使用者仍需注意輸入電壓不可超出5.5V。但作為ADC輸入使用設置為模擬模式時
，則失去耐5V特性，使用者需注意輸入電壓不可超出VDD+0.3V。

在GPIO引腳輸入負電壓也會幹擾ADC的轉換。注意輸入電壓不可低於-0.3V。

模擬輸入信號噪聲

在采樣時間內，小而高頻率的信號變化可導致較大轉換誤差。此噪聲由電氣設備（例如電機

、發動機點火
、電源線）生成。它增加了不需要的信號，因此會影響模擬輸入源信號（例如：傳感器）。這樣一來，導致ADC轉換結果不準確。

●  采樣平均濾波

此ci方fang法fa是shi一yi個ge簡jian單dan的de技ji巧qiao
，即ji通tong過guo軟ruan件jian對dui模mo擬ni輸shu入ru多duo次ci采cai樣yang，取qu所suo有you結jie果guo的de均jun值zhi。當dang模mo擬ni電dian壓ya不bu頻pin繁fan變bian化hua時shi
，此ci技ji巧qiao有you助zhu於yu消xiao除chu模mo擬ni輸shu入ru上shang的de噪zao聲sheng。如ru果guo被bei測ce模mo擬ni信xin號hao產chan生sheng不bu穩wen定ding的deADC值，軟件運算時則可以通過剔除大值和小值，選擇適當數量的待平均樣本執行平均。此數量取決於需要的精度
、最低轉換速度。

平均濾波法的優勢是可以在無任何硬件變更的情況下提高ADC精度。它的缺點是轉換速度和頻率響應較慢，相當於降低了有效采樣頻率。

平均濾波法也針對不同需求發展出各樣差別，如：限幅濾波、中位值濾波、遞推平均濾波、消抖濾波及其組合等等的算法。使用者可根據信號特性和芯片資源選擇合適的數據平均方式。

●  添加外部濾波器

添加外部RC濾波器以消除高頻。無需使用昂貴的濾波器來處理頻率分量高於所涉頻率範圍的信號。這種情況下
，截止頻率fC剛好高於所涉頻率範圍的相對簡單的低通濾波器將足以限製噪聲和混疊。使用與所涉最高頻率相同的采樣率足以，通常為fC的2至5倍。

但添加了外部RC濾波器時
，ADC的采樣時間和采樣間隔都需要重新評估，否則可能造成更大的量測誤差。請詳細參考第3章內容。

模擬信號源阻抗的影響

在源和引腳之間的模擬信號源的阻抗或串聯電阻（RAIN），可能會因為采樣時流入或流出引腳的電流而導致其上的電壓瞬間改變，這時ADC內部采樣保持電容充滿電所需要的時間會延長。如果采樣時間短於將內部采樣電容充分充放電所需的時間
，則ADC轉換的數字值會與實際值有徧差。

關於模擬信號源具有高輸入阻抗特性或加入RC濾波器時，ADC的測量設置請詳細參考第3章內容。

CPU生成的內部噪聲

當CPU（以及其他外設）操作時
，會產生大量內部和外部信號變化，這些變化通過電容耦合傳輸到ADC外設。此類幹擾影響ADC精度。

為使CPU（以及其他外設）對ADC的影響最小化
，必須使采樣和轉換期間的數字信號變化量最小化（數字靜默）。使用下列方法之一可以實現這一點（在采樣和轉換時間內實現）：

● 內部CPU變化量最小化（CPU停止
，等待模式）

● 停止非必要外設（計時器
、通信等）的時鍾

溫度影響

溫度對ADC精度有重要影響。它主要產生兩種重要誤差：偏移誤差漂移和增益誤差漂移。建議使用內部溫度傳感器和ADC看門狗，以在溫度變化達到給定值時重新校準ADC。

I/O引腳串擾

由於I/O之間的電容耦合
，切換I/O可能會在ADC的模擬輸入中產生一些噪聲。彼此距離很近或交叉的PCB走線可能會產生串擾。內部切換數字信號和I/O會產生高頻噪聲。由於電流浪湧，切換高灌電流I/O可能導致電源電壓小幅下降。

PCB上與模擬輸入走線交叉的數字走線可能影響模擬信號。通過讓接地走線來屏蔽模擬信號
，可以減少串擾產生的噪聲。PCB布線時
，應考慮對ADC輸入信號給予屏蔽，可在信號線周圍鋪銅並就近接地，同時應盡量縮短走線距離。另外在ADC采樣和轉換時間內實現I/O引腳變化量最小化
，對減小對ADC的幹擾很有幫助。

EMI產生的噪聲

鄰近電路產生的電磁輻射可能在模擬信號中產生高頻噪聲，此時PCB走zou線xian相xiang當dang於yu天tian線xian接jie收shou幹gan擾rao噪zao聲sheng。使shi用yong者zhe可ke以yi通tong過guo在zai可ke能neng的de發fa射she源yuan和he接jie收shou器qi之zhi間jian提ti供gong物wu理li隔ge離li，或huo通tong過guo適shi當dang的de接jie地di和he屏ping蔽bi措cuo施shi對dui它ta們men進jin行xing電dian氣qi隔ge離li。

沿敏感模擬信號布置接地走線

，在PCB上提供屏蔽。雙層PCB的另一側也應具有接地板。這樣可以防止幹擾和I/O串擾影響信號。應使用屏蔽線纜將遠距離信號（例如：傳感器）連接到PCB或注意盡可能縮短PCB上信號的路徑長度。晶振、時鍾以及存在快速變化的信號線盡量遠離ADC輸入信號。

ADC輸入源阻抗對測量的影響和正確的設置方式 

SAR ADC的量測要求設置足夠的采樣時間讓ADC內采樣電路充分充、放電
，以獲得轉換的準確性。多通道間切換的使用也是同樣道理，足夠的采樣時間可以避免輸入通道間的交互幹擾（crosstalk）。為了計算估計的采樣時間
，圖3給出一個能近似ADC采樣線路的等效阻值和容值（包含：模擬多工器、模擬開關、寄生電容、采樣電容…等）的電路圖。

圖3. 輸入級與ADC簡化示意圖 - 采樣和保持電路

其中模擬信號輸入源對ADC的輸入阻抗（RAIN）
，直接與ADC采樣時間有關，影響ADC轉換結果甚巨。未考慮輸入阻抗使得ADC輸入的外部器件與軟件設置的采樣時間不批配，往往是造成ADC使用問題的原因。以下分別針對信號源具有一般輸入阻抗或高輸入阻抗，分別探討如何正確設置ADC的軟
、硬件。

一般輸入阻抗的測量設置

VC是內部CADC電容兩側的電壓（請參見圖4）。對於給定的采樣tC
，可以考慮VAIN=VREF+所對應的tC需要采樣時間是最大值
，因為此時CADC電容需要最多時間從0V充電到VAIN。因此
，VAIN=VREF是驗證最大源電阻時要考慮的最壞情況。通過軟件設置增加采樣時間或降低ADC時鍾頻率可等效加長采樣時間，當采樣時間越長越可以獲得好的轉換結果。

圖4. 模擬信號源對采樣和保持電路充電示意圖

一般我們假設允許的最大誤差等於1 LSB，照RC充放電公式：

其中V（t）帶入VREF×(1-1/212)，VAIN帶入VREF
；而時間常數τ=（RAIN+RADC）xCADC，采樣時間大於8.32x（RAIN+RADC）xCADC就可達到1 LSB誤差之內。若使用者要求較低的準確度，可進一步增大允許的外部電阻RAIN。

高輸入阻抗的測量設置

ADC輸入信號源常有存在高阻特性。例如係統電池電壓經電阻分壓後輸入給ADC采集，因分壓電阻會形成一個直流耗電路徑，為節省耗電
，分壓電阻串常使用100 kΩ到1 MΩ的阻值組合而成。又或者有些傳感器本身為弱電流輸出，通過外接一大電阻轉換為電壓後輸入給ADC。以上硬件往往都無法以上一節方法調試出適合的采樣時間，（例如軟件已設置采樣時間至最大值仍無法獲得準確的轉換值，或降低ADC時鍾又使得整體采樣間隔太長
，）此時可以在ADC輸入通道前增加運算放大器
，可以提高輸入驅動能力

，如圖5。此方案可大大縮短ADC的采樣時間以及采樣間隔，但缺點是增加了器件成本。另外在設計前置放大器時，必須注意可能額外產生的誤差（例如額外的偏移、放大器增益穩定性或線性、頻率響應）。並且若未慎選運算放大器，這些放大器的誤差會成為另外測量誤差的來源。

圖5. ADC輸入通道前增加運算放大器示意圖

若硬件電路不容許增加運算放大器

，無法通過提高采樣時間滿足要求
，此時還可以采用外接電容作為電荷存儲器的方法。

SAR ADCneibucaiyangbaochidianrongzaicaiyangkaiguanjietonghou，zaicaibaodianrongwendingshijianneixuyaoyigezugoudechongfangdiandianliu
，ertongchangshijidexinhaodianluruojuyoujiaogaodeshuruzukang，wangwangbunengtigongzugoudadedianliukuaisuweiADC內采樣電容充電。為此大部分的應用都采用在ADC輸入管腳到地接一個外部大電容作為一個電荷存儲器，即圖3中的CEXT。這個電容參與采樣時電路的充放電過程，以便向SAR ADC采樣電容提供充足的電荷，而對內部采樣電容進行快速充電，並且穩定ADC輸入點的電壓。此CEXT與RAIN組成的RC濾波器也順帶限製到達ADC輸入端的帶外噪聲，同時也幫助衰減ADC輸入端中開關電容頻繁切換和通斷的反衝噪聲影響。當然此RC濾波器也限製了VAIN信號源的截止頻率。

● 計算C

當采樣開關接通後，會在CEXT和CADC之間有一段電荷重新分配的過程，這一段RC時間常數主要是由RADC的最大阻值和CADC的最大容值決定的。

在考慮CEXT和CADC之間電荷分配時，CPAD因為相對微小且與CEXT並聯，是可以忽略的。電荷分配的算式是基於「分配前的全部電荷等於分配後的全部電荷」。

假設現在CADC是完全放電的
，而CEXT儲存著和VAIN一樣的電壓。VC（分配後的電壓）定規為VAIN的0.999939倍

，這個意義是VC最後徧差在VAIN的1 LSB之內，以12位解析度來記算。

例如CADC=15 pF,

CEXT=4095x15 pF=61.4 nF。

這是CEXT的絕對最小值。在實際選擇器件值時必需確認考慮到器件誤差和老化因素，選擇大一點的值是可以的，如68 nF。如果電容值選擇再大，其實對采樣時間要再縮短並沒有實質幫助，反而限製了ADC輸入信號的頻寬。

但如果一個12位的ADC配罝CEXT<4095xCADC
，反而會要求相當大的采樣時間讓CADC充電足夠。所以若CEXT<4095xCADC而且使用者若沒有需要anti-aliasing濾波器的情況下，還不如不要加CEXT。若要求的精準度沒有這麼高，CEXT的數值可以照前麵公式減小
，這時ADC輸入信號的頻寬就增大了。相反的若要求精準度，CEXT就必須提高了，就要付出ADC采樣時間間隔要拉大
，ADC輸入信號的頻寬縮小的代價。

●  計算RAIN

所有對外部電容CEXT充電的阻值總合程為RAIN，也就是從CEXT看到驅動信號源的等效阻值。當CEXT變大，CEXT和CEXT所型成的截止頻率就會變低。這表示當輸入信號開始變動到CEXT電荷穩定的這段反應時間會增加。

要準確度穩定達到12位解析度誤差1 LSB之內
，RC線路的時間常數要求為：

ln(212)=8.32倍。

Cext和Rain型成的截止頻率為：

以前段CEXT=62 nF為例，若RAIN=200Ω，截止頻率可達9.7kHz；但若RAIN=20kΩ，僅可接受97Hz。源的頻率若超以上截止頻率
，ADC轉換結果會不準確。

注意此時程序不得將ADC設定為連續模式，而應設定為單點模式或以定時器間隔觸發轉換，軟件必 須確保兩次轉換之間的時間間隔等於或大於1/f。

●  采樣時間不足的後果

若遵照計算CEXT的方式在ADC輸入放置足夠大的CEXT，要使CADC穩定所需要的時間就顯得非常短。另外也隻有一個情況之下可以不需要CEXT就是RAIN很小的時候。一般來說RAIN很小是因為傳感器有輸出緩衝極，這是RAIN都小於100Ω。以上情況采樣時間都容易滿足。

不足的采樣時間會造成ADC通道間互相幹擾。就如本文開頭所討論的，這是因為電荷從一個通道累積在CADC上並轉移到另一個通道
，造成通道間互相影響。

●  信號源高阻的後果

通常造成以上所述通道間幹擾的原因是因為信號源輸入阻抗太高了。若要達到1 LSB的準確度，就必需在各通道轉換中間加入延時，後果就是整體的轉換時間變慢。

如果沒有加上CEXT或著電容值太小，而采樣時間又不足，ADC轉換出來的結果因為通道間幹擾而永遠達不到1 LSB的準確度。

關於輸入阻抗匹配的其他建議

以近期ADC朝向低功耗、高采樣頻率、並複雜功能的方向進行設計，ADC的采樣行為已經不是如上文以一階簡易的RADC和CADC模型可以仿真的了，因此近期普遍ADC規格中隻提供CADC的典型值，而不再提供RADC數值。取而代之的是ADC輸入信號阻抗（R_AIN）與采樣時間（ts）的對應關係表
，如下表所示。（下表自AT32F403A係列數據手冊截取。）

表1. fADC=28MHz時的最大RAIN(1)

(1) 由設計保證。

在可以得知ADC信號源的輸入阻抗時，使用者不需進行計算，隻要照表格指示透過軟件設置足夠的采樣時間
，一般都會得到合理的ADC轉換值。但在一般情況下，使用者常常難以直接或間接得知ADC輸入信號的阻抗時，最好的方法是逐步調試軟件采樣時間。

使用者可以依照下述步驟調試ADC的采樣時間：

●首先設置ADC時鍾頻率為最高值

，並設置采樣周期為最大值
；

●嚐試ADC轉換並檢視轉換結果
；

●若轉換數值符合預期

，則可逐步調試減小采樣周期並觀察ADC轉出值，以求得足夠而不過長的采樣時間；

●若最大采樣時間所得轉換值不符合預期
，使用者需要降低ADC時鍾頻率，或是照著前文計算並外加合適大小的CEXT；硬件設置完成後再修改軟件設置，逐步調試出合適的采樣時間及采樣間隔。

另外若采樣間隔時間許可時，采取一些軟件技巧也會提高ADC轉換的準確度，例如：

●采用平均法、移動平均法、或中值濾波；

●對同一ADC通(tong)道(dao)采(cai)樣(yang)兩(liang)次(ci)
，將(jiang)第(di)一(yi)次(ci)的(de)值(zhi)丟(diu)棄(qi)而(er)使(shi)用(yong)第(di)二(er)次(ci)的(de)采(cai)樣(yang)的(de)值(zhi)。此(ci)種(zhong)方(fang)式(shi)可(ke)以(yi)消(xiao)除(chu)輸(shu)入(ru)源(yuan)內(nei)阻(zu)過(guo)大(da)而(er)在(zai)不(bu)同(tong)通(tong)道(dao)切(qie)換(huan)時(shi)
，上(shang)一(yi)個(ge)通(tong)道(dao)的(de)電(dian)壓(ya)來(lai)不(bu)及(ji)從(cong)采(cai)樣(yang)電(dian)阻(zu)放(fang)電(dian)而(er)累(lei)積(ji)的(de)電(dian)荷(he)
，導(dao) 致影響下一個通道的轉換值；

●若ADC輸入信號大約在0V到VREF+/2時
，可交替轉換該ADC輸入通道和內部VINTRV源

，也可達到讓采樣電阻有足夠時間充放電的效果
，避免通道間幹擾。若有內部VSSA通道，交替轉換ADC輸入通道和內部VSSA通道效果會更好且省時。因為讓ADC采樣電路放電到VSSA比起充放電到VINTRV可以以更快的采樣時間達成。

其它ADC應用指南 

內部參考電壓VINTRV的設置目的與使用方式

內部參考電壓（VINTRV）為ADC提供了一個穩定的電壓輸出。VINTRV內部連接到ADC1_IN17輸入通道上
，用於將VINTRV的輸出轉換為數字數值。

VINTRV是一個芯片內部的一個恒定電壓信號源，按規格為1.2V±3.3%，在所有VDDA操作電壓範圍內都維持在此穩定電壓規格內
，不隨VDDA電壓變動而變化。因此，VINTRV在ADC的外部VREF+（通常與VDDA同電源）的電壓未知或VVREF+電壓會變動時（例如：使用電池電源）
，可用來參照推算出VREF+或VDDA電壓以及各ADC_IN輸入的準確絕對電壓值。

例如：選定V_INTRV通道經ADC轉換後數值若為1650（Code_VINTRV），就可以推算出電壓滿格的VREF+或VDDA的電壓為1.2x4096/1650=2.979V。此時若另一選定的ADC_IN外部通道轉換出來的數值為800（Code_VAIN），就可采用以下兩種計算方式：1.2x800/1650或2.979x800/4096
，計算出此外部信號電壓VAINx為0.582V。

以上範例使用公式如下：

使用者可以根據應用係統電源的特性，決定對VINTRV轉換次數及間隔。若電源為電壓未知但不變動，可於係統上電後並在ADC初始化並校正後，一次性對VINTRV轉換
；若電源為變動電壓，就要根據電源變動速度和係統需求決定對VINTRV轉換間隔，多次對VINTRV轉換並更新此參照值，甚至需要對ADC重新校正。另外溫度變化也可能使電源情況有改變，也可參考2.2.6節內容啟動對VINTRV轉換。因VINTRV為內部弱電壓源
，ADC進行采樣時需要足夠時間讓VINTRV為采樣電路正確充放電，使用者需確實遵照數據手冊中的TS_INTRV參數為VINTRV設置足夠的采樣時間，以獲得正確的轉換數值。

推薦閱讀：

鎖相環中的鑒相器了解不
？

漲知識了！MEMS也可以用來監測地震

24GHz雷達傳感器如何改變智能家居的未來

基於COM－HPC技術滿足邊緣計算需求高峰

貿澤推出豐富的開發套件與工程工具資源，助你快速上手產品設計