模擬電路上下拉電阻解惑:作用、原理和選擇
發布時間:2013-08-14 來源:電子元件技術網論壇 責任編輯:Cynthiali
【導讀】你是不是對上下拉電阻有迷惑?看過這篇原創文章你就全都明白了:上下拉電阻定義、上下拉電阻作用、上拉電阻阻值的選擇原則、對其輸入/輸出引腳的解釋……幫很多工程師解過惑哦,你肯定不想錯過!
一、上下拉電阻定義:
上拉就是將不確定的信號通過一個電阻嵌位在高電平!電阻同時起限流作用!下拉同理!
上拉是對器件注入電流,下拉是輸出電流;弱強隻是上拉電阻的阻值不同,沒有什麼嚴格區分;對於非集電極(或漏極)開路輸出型電路(如普通門電路)提升電流和電壓的能力是有限的,上拉電阻的功能主要是為集電極開路輸出型電路輸出電流通道。
二、上下拉電阻作用:
1、提高電壓準位:a.當TTL電路驅動COMS電路時,如果TTL電路輸出的高電平低於COMS電路的最低高電平(一般為3。5V), 這時就需要在TTL的輸出端接上拉電阻,以提高輸出高電平的值。b.OC門電路必須加上拉電阻,以提高輸出的搞電平值。
2、加大輸出引腳的驅動能力,有的單片機管腳上也常使用上拉電阻。
3、N/A pin防靜電、防幹擾:在COMS芯片上,為了防止靜電造成損壞,不用的管腳不能懸空,一般接上拉電阻產生降低輸入阻抗, 提供泄荷通路。同時管腳懸空就比較容易接受外界的電磁幹擾。
4、電阻匹配,抑製反射波幹擾:長線傳輸中電阻不匹配容易引起反射波幹擾,加上下拉電阻是電阻匹配,有效的抑製反射波幹擾。
5、預設空間狀態/缺省電位:在一些 CMOS 輸入端接上或下拉電阻是為了預設缺省電位。 當你不用這些引腳的時候, 這些輸入端下拉接 0 或上拉接 1。在I2C總線等總線上,空閑時的狀態是由上下拉電阻獲得
6。 提高芯片輸入信號的噪聲容限:shuruduanruguoshigaozuzhuangtai,huozhegaozukangshuruduanchuyuxuankongzhuangtai,cishixuyaojiashanglahuoxiala,yimianshoudaosuijidianpingeryingxiangdianlugongzuo。tongyangruguoshuchuduanchuyubeidongzhuangtai,xuyaojiashanglahuoxiala,rushuchuduanjinjinshiyigesanjiguandejidianji。congertigaoxinpianshuruxinhaodezaoshengrongxianzengqiangkangganraonengli。
{電源到元件間的叫上拉電阻,作用是平時使該腳為高電平
地到元件間的叫下拉電阻,作用是平時使該腳為低電平
上拉電阻和下拉電阻的範圍由器件來定(我們一般用10K)
+Vcc
+------+=上拉電阻
|+-----+
|元件|
|+-----+
+------+=下拉電阻
-Gnd
一般來說上拉或下拉電阻的作用是增大電流,加強電路的驅動能力
比如說51的p1口
還有,p0口必須接上拉電阻才可以作為io口使用
上拉和下拉的區別是一個為拉電流,一個為灌電流
一般來說灌電流比拉電流要大
也就是灌電流驅動能力強一些}
三、上拉電阻阻值的選擇原則:
1、從節約功耗及芯片的灌電流能力考慮應當足夠大;電阻大,電流小。
2、從確保足夠的驅動電流考慮應當足夠小;電阻小,電流大。
3、對於高速電路,過大的上拉電阻可能邊沿變平緩。綜合考慮
以上三點,通常在1k到10k之間選取。對下拉電阻也有類似道理
下頁內容:上下拉電阻原理
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四、上下拉電阻原理:
上(shang)拉(la)電(dian)阻(zu)實(shi)際(ji)上(shang)是(shi)集(ji)電(dian)極(ji)輸(shu)出(chu)的(de)負(fu)載(zai)電(dian)阻(zu)。不(bu)管(guan)是(shi)在(zai)開(kai)關(guan)應(ying)用(yong)和(he)模(mo)擬(ni)放(fang)大(da),此(ci)電(dian)阻(zu)的(de)選(xuan)則(ze)都(dou)不(bu)是(shi)拍(pai)腦(nao)袋(dai)的(de)。工(gong)作(zuo)在(zai)線(xian)性(xing)範(fan)圍(wei)就(jiu)不(bu)多(duo)說(shuo)了(le),在(zai)這(zhe)裏(li)是(shi)討(tao)論(lun)的(de)是(shi)晶體管是開關應用,所以隻談開關方式。找個TTL器(qi)件(jian)的(de)資(zi)料(liao)單(dan)獨(du)看(kan)末(mo)級(ji)就(jiu)可(ke)以(yi)了(le),內(nei)部(bu)都(dou)有(you)負(fu)載(zai)電(dian)阻(zu)根(gen)據(ju)不(bu)同(tong)驅(qu)動(dong)能(neng)力(li)和(he)速(su)度(du)要(yao)求(qiu)這(zhe)個(ge)電(dian)阻(zu)值(zhi)不(bu)同(tong),低(di)功(gong)耗(hao)的(de)電(dian)阻(zu)值(zhi)大(da),速(su)度(du)快(kuai)的(de)電(dian)阻(zu)值(zhi)小(xiao)。
但(dan)芯(xin)片(pian)製(zhi)造(zao)商(shang)很(hen)難(nan)滿(man)足(zu)應(ying)用(yong)的(de)需(xu)要(yao)不(bu)可(ke)能(neng)同(tong)種(zhong)功(gong)能(neng)芯(xin)片(pian)做(zuo)許(xu)多(duo)種(zhong),因(yin)此(ci)幹(gan)脆(cui)不(bu)做(zuo)這(zhe)個(ge)負(fu)載(zai)電(dian)阻(zu),改(gai)由(you)使(shi)用(yong)者(zhe)自(zi)己(ji)自(zi)由(you)選(xuan)擇(ze)外(wai)接(jie),所(suo)以(yi)就(jiu)出(chu)現(xian)OC、OD輸shu出chu的de芯xin片pian。由you於yu數shu字zi應ying用yong時shi晶jing體ti管guan工gong作zuo在zai飽bao和he和he截jie止zhi區qu,對dui負fu載zai電dian阻zu要yao求qiu不bu高gao,電dian阻zu值zhi小xiao到dao隻zhi要yao不bu小xiao到dao損sun壞huai末mo級ji晶jing體ti管guan就jiu可ke以yi,大da到dao輸shu出chu上shang升sheng時shi間jian滿man足zu設she計ji要yao求qiu就jiu可ke,隨sui便bian選xuan一yi個ge都dou可ke以yi正zheng常chang工gong作zuo。
但(dan)是(shi)一(yi)個(ge)電(dian)路(lu)設(she)計(ji)是(shi)否(fou)優(you)秀(xiu)這(zhe)些(xie)細(xi)節(jie)也(ye)是(shi)要(yao)考(kao)慮(lv)的(de)。集(ji)電(dian)極(ji)輸(shu)出(chu)的(de)開(kai)關(guan)電(dian)路(lu)不(bu)管(guan)是(shi)開(kai)還(hai)是(shi)關(guan)對(dui)地(di)始(shi)終(zhong)是(shi)通(tong)的(de),晶(jing)體(ti)管(guan)導(dao)通(tong)時(shi)電(dian)流(liu)從(cong)負(fu)載(zai)電(dian)阻(zu)經(jing)導(dao)通(tong)的(de)晶(jing)體(ti)管(guan)到(dao)地(di),截(jie)止(zhi)時(shi)電(dian)流(liu)從(cong)負(fu)載(zai)電(dian)阻(zu)經(jing)負(fu)載(zai)的(de)輸(shu)入(ru)電(dian)阻(zu)到(dao)地(di),如(ru)果(guo)負(fu)載(zai)電(dian)阻(zu)選(xuan)擇(ze)小(xiao)點(dian)功(gong)耗(hao)就(jiu)會(hui)大(da),這(zhe)在(zai)電(dian)池(chi)供(gong)電(dian)和(he)要(yao)求(qiu)功(gong)耗(hao)小(xiao)的(de)係(xi)統(tong)設(she)計(ji)中(zhong)是(shi)要(yao)盡(jin)量(liang)避(bi)免(mian)的(de),如(ru)果(guo)電(dian)阻(zu)選(xuan)擇(ze)大(da)又(you)會(hui)帶(dai)來(lai)信(xin)號(hao)上(shang)升(sheng)沿(yan)的(de)延(yan)時(shi),因(yin)為(wei)負(fu)載(zai)的(de)輸(shu)入(ru)電(dian)容(rong)在(zai)上(shang)升(sheng)沿(yan)是(shi)通(tong)過(guo)無(wu)源(yuan)的(de)上(shang)拉(la)電(dian)阻(zu)充(chong)電(dian),電(dian)阻(zu)越(yue)大(da)上(shang)升(sheng)時(shi)間(jian)越(yue)長(chang),下(xia)降(jiang)沿(yan)是(shi)通(tong)過(guo)有(you)源(yuan)晶(jing)體(ti)管(guan)放(fang)電(dian),時(shi)間(jian)取(qu)決(jue)於(yu)器(qi)件(jian)本(ben)身(shen)。因(yin)此(ci)設(she)計(ji)者(zhe)在(zai)選(xuan)擇(ze)上(shang)拉(la)電(dian)阻(zu)值(zhi)時(shi),要(yao)根(gen)據(ju)係(xi)統(tong)實(shi)際(ji)情(qing)況(kuang)在(zai)功(gong)耗(hao)和(he)速(su)度(du)上(shang)兼(jian)顧(gu)。
下麵從IC(MOS工藝)的角度,分別就輸入/輸出引腳做一解釋:
1、 對芯片輸入管腳, 若在係統板上懸空(未與任何輸出腳或驅動相接)是比較危險的。因為此時很有可能輸入管腳內部電容電荷累積使之達到中間電平(比如1。5V), 而使得輸入緩衝器的PMOS管和NMOS管同時導通, 這樣一來就在電源和地之間形成直接通路, 產生較大的漏電流, 時間一長就可能損壞芯片。 並且因為處於中間電平會導致內部電路對其邏輯(0或1)判斷混亂。 接上上拉或下拉電阻後, 內部點容相應被充(放)電至高(低)電平, 內部緩衝器也隻有NMOS(PMOS)管導通, 不會形成電源到地的直流通路。 (至於防止靜電造成損壞, 因芯片管腳設計中一般會加保護電路, 反而無此必要)。
2、 對於輸出管腳:
1)正常的輸出管腳(push-pull型), 一般沒有必要接上拉或下拉電阻。
2)OD或OC(漏極開路或集電極開路)型管腳,
這種類型的管腳需要外接上拉電阻實現線與功能(此時多個輸出可直接相連。 典型應用是: 係統板上多個芯片的INT(中斷信號)輸出直接相連, 再接上一上拉電阻, 然後輸入MCU的INT引腳, 實現中斷報警功能)。
其工作原理是:
在正常工作情況下, OD型管腳內部的NMOS管關閉, 對外部而言其處於高阻狀態, 外接上拉電阻使輸出位於高電平(無效中斷狀態); 當有中斷需求時, OD型管腳內部的NMOS管接通, 因其導通電阻遠遠小於上拉電阻, 使輸出位於低電平(有效中斷狀態)。 針對MOS 電路上下拉電阻阻值以幾十至幾百K為宜。
(注: 此回答未涉及TTL工藝的芯片, 也未曾考慮高頻PCB設計時需考慮的阻抗匹配, 電磁幹擾等效應。)
1)芯片引腳上注明的上拉或下拉電阻, 是指設計在芯片引腳內部的一個電阻或等效電阻。 設計這個電阻的目的, 是為了當用戶不需要用這個引腳的功能時, 不用外加元件, 就可以置這個引腳到缺省的狀態。 而不會使 CMOS 輸入端懸空。 使用時要注意如果這個缺省值不是你所要的, 你應該把這個輸入端直接連到你需要的狀態。
2)這個引腳如果是上拉的話, 可以用於 "線或" 邏輯。 外接漏極開路或集電極開路輸出的其他芯片。 組成負邏輯或輸入。 如果是下拉的話, 可以組成正邏輯 "線或", 但外接隻能是 CMOS 的高電平漏極開路的芯片輸出, 這是因為 CMOS 輸出的高, 低電平分別由 PMOS 和 NMOS 的漏極給出電流, 可以作成 P 漏開路或 N 漏開路。 而 TTL 的高電平由源極跟隨器輸出電流, 不適合 "線或"。
3)TTL 到 CMOS 的驅動或反之, 原則上不建議用上下拉電阻來改變電平, 最好加電平轉換電路。 如果兩邊的電源都是 5 伏, 可以直接連但影響性能和穩定, 尤其是 CMOS 驅動 TTL 時。 兩邊邏輯電平不同時, 一定要用電平轉換。 電源電壓 3 伏或以下時, 建議不要用直連更不能用電阻拉電平。
4)芯片外加電阻由應用情況決定, 但是在邏輯電路中用電阻拉電平或改善驅動能力都是不可行的。 需要改善驅動應加驅動電路。 改變電平應加電平轉換電路。 包括長線接收都有專門的芯片。
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