電路設計中減小電路板上串擾的設計原則
發布時間:2017-05-23 責任編輯:susan
【導讀】隨sui著zhe電dian路lu板ban上shang走zou線xian密mi度du越yue來lai越yue高gao,信xin號hao串chuan擾rao總zong是shi一yi個ge難nan以yi忽hu略lve的de問wen題ti。因yin為wei不bu僅jin僅jin會hui影ying響xiang電dian路lu的de正zheng常chang工gong作zuo,還hai會hui增zeng加jia電dian路lu板ban上shang的de電dian磁ci幹gan擾rao。
在電路板上的一些高頻信號會串擾到MCU電路或者MCU的I/O接jie口kou電dian路lu,形xing成cheng共gong模mo電dian壓ya,眾zhong所suo周zhou知zhi,共gong模mo電dian壓ya在zai電dian路lu設she計ji時shi是shi最zui讓rang人ren討tao厭yan的de玩wan意yi兒er,因yin此ci,設she計ji電dian路lu板ban時shi要yao避bi免mian各ge種zhong可ke能neng造zao成cheng電dian路lu工gong作zuo不bu正zheng常chang的de共gong模mo電dian壓ya的de串chuan擾rao。

減小電路板上串擾的設計原則簡單歸類
1,通過合理布局使各個元器件之間的連線盡量短。
2,由於串擾程度和施加幹擾信號的頻率成正比,因此要使高頻信號線遠離敏感信號線。
3,施加幹擾信號線與受到幹擾信號線不僅要遠離,最好要用地線隔離,並且避免相互平行走線。
4,在多層PCB板中,施加幹擾信號線與受到幹擾信號線或敏感信號走線要用地線隔離或相隔地層。
5,在多層PCB板中,施加幹擾信號線與受到幹擾信號線分別在地線或地層的相對兩麵,也就是隔層。
6,盡量使用輸入阻抗較低的敏感電路,必要時可以使用旁路電容降低敏感電路的輸入阻抗。
最後注意的是,在布線時,地線對於抑製信號串擾的作用是非常明顯的,在幹擾線和受幹擾線直接布地線,可以將串擾降低10db左右。
著名的3W布線規則
在抑製電路板走線信號串擾方麵,有一個非常有名的3W布線規則(其中W就是布線寬度),它的內容是:對於寬度是3W的信號線,如果其他走線的中心和它的中心之間的距離大於3W,就能避免信號之間的串擾。如下圖所示。

根據這個規則,3W範圍內包含了信號電流產生的75%的磁通量,隻要相鄰的導線在這個範圍之外,信號之間的串擾就不會很嚴重,值得注意的是,信號電流產生的磁通量的98%包含在10W範圍內。
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